随着半导体工艺进入纳米级时代，集成电路的功耗问题已从次要约束演变为设计成败的核心挑战。传统设计流程中，功耗优化往往滞后于功能实现与物理设计，导致后期迭代成本高昂且效率低下。本演讲将聚焦于设计流程早期阶段功耗优化难题，通过即将发布的一款自研且国内首创的RTL功耗优化工具，探讨如何通过微架构级（micro-architecture）功耗建模与逻辑重构（transformation）实现RTL阶段有效功耗优化的设计自动化。
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